一、Cache 的基本工作原理
Cace位于存储器层次结构的顶层，通常由SRAM构成。
Cache和主存都被分成若干大小相等的块(Cache块又称为Cache行)，每块由若干字节组成，块的长度称为块长(Cache行长)。由于Cache的容量远小于主存的容量，所以Cache中的块数要远少于主存中的块数，它仅保存主存中最活跃的若干块的副本。故而Cache按照某种策略，预测CPU在未来一段时间内欲访存的数据，将其装入Cache。
当CPU发出读请求时，如果访存地址在Cache中命中，就将此地址转换成Cache地址，直接对Cache进行读操作，与主存无关；如果Cache不命中，则仍需访问主存，并把此字所在的块一次从主存调入Cache内。若此时Cache已满，则需根据某种替换算法，用这个块替换掉Cache中原来的某块信息。值得注意的是，CPU与Cache之间的数据交换以字为单位，而Cache与主存之间的数据交换则是以Cache块为单位。
二、Cathe的实现依据
高速缓冲技术就是利用程序访问的局部性原理
，把
程序中正在使用
的部
分存放在一
个高速
的、容量较小的 Cache
中，使
CPU
的访存操作大多数针对
Cache
进行，从而使程序的执行速度
大大提高。
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